利用锁相环的频率合成方法，其中有一相位比较器，特别是在述及的锁相环的运行中在稳定时间或稳定延时之后有将分数分频运行方式转化为整数分频运行方式的转变。这种方法的特征在于它是在将参考信号(Sref)和比较信号(Scomp)作用于相位比较器(3)的输入端之前周期性地消除或屏蔽这两种信号的部分脉冲来控制这种运行方式转变的。
  [HT8495-0155-0004] 万用型时钟产生器
[摘要] 本发明涉及一种万用型时钟产生器，包含一用于产生高频时钟信号的高频时钟区及一用于产生低频时钟信号的低频时钟区。该低频时钟区包含至少一延迟锁定回路，用于扩增该高频时钟区的高频时钟信号的脚位个数。当高频的中央处理器时钟、SDRAM时钟、AGP时钟和PCI时钟脚数不足时，则可串接该低频时钟区内的延迟锁定回路，以补足不足的脚位。
  [HT8495-0129-0005] 多功能声光可调谐滤波器的驱动器
[摘要] 本发明公开了一种多功能声光可调谐滤波器的驱动器，它是在驱动器内设置由加法器、D/A转换器、微处理器用导体顺序连接组成的智能锁相环电路。其加法器并设置在鉴相低通滤波器与压控振荡器的连接导体中，微处理器由导体分别与鉴相低通滤波器及除N分频器连接，用于快速产生和输出可调高频信号。本发明还在控制面板上设置有功能转换开关，用于手动、或可编程、计算机的等多种控制方式的选择转换。本发明与传统的声光可调谐滤波器的驱动器及其内的锁相环电路相比，其频率锁定时间缩短了近10倍，可广泛适合于多种场所快速输出高频信号的需要。
  [HT8495-0204-0006] 占空比校正电路
[摘要] 提供一种可以将时钟的占空比校正到50％的占空比校正电路。包括：将时钟(CK1)延迟后输出时钟(CK2)的延迟部(11A)；由分别以时钟(CK1、CK2)作为栅极输入的晶体管(12、13)和将其共同的漏极输出的信号(CK3’)反相后输出时钟(CK3)的反相器电路(16)所构成的时钟输出部(17)。延迟部(11A)按照让时钟(CK1)下降变化出现在占空比为50％的时刻那样对时钟(CK1)延迟。晶体管(12、13)分别根据时钟(CK1)的上升变化以及时钟(CK2)的下降变化从共同的漏极输出接地电压和电源电压(信号CK3’)。最后获得占空比大约为50％的时钟(CK3)。
  [HT8495-0191-0007] 一种锁相环
[摘要] 一种锁相环，它结合了用于保留限定锁相环运行模式数据的第一寄存器组(21)；用于限定定义锁相环运行模式数据的第二寄存器组(22)。开关(27至30)被用来在与第一和第二寄存器组中的一组结合，以接收限定锁相环新运行模式的数据，而此时，第一和第二寄存器组的另一组被连接至锁相环，以在另一组寄存器组中限定的模式同样运行。开关是可重新配置改变结合的，以使另一组寄存器组被结合以接收限定更新运行模式的数据，而此时，一个寄存器组被连接至锁相环以在新的运行模式中运行。
  [HT8495-0171-0008] 频率锁定环，时钟恢复电路和接收器
[摘要] 一个频率锁定环，包括可控振荡器(1)和控制信号发生器(2)，用来根据参考信号(Sref)和振荡器(1)的输出信号(So)产生振荡器(1)的控制信号(Sc)。该频率锁定环的特征在于，控制信号发生器(2)包括：-第一回路，包括高通滤波器(21)和非线性处理单元(22)，根据参考信号(Sref)产生第一中间信号(S1)，-第二回路，包括高通滤波器(23)和非线性处理单元(24)，根据可控振荡器(1)的输出信号(So)产生第二中间信号(S2)，-合并单元(25)，根据第一中间信号(S1)和第二中间信号(S2)产生第三中间信号(S3)，-低通滤波器(26)，根据第三中间信号(S3)来提供控制信号(Sc)。
  [HT8495-0046-0009] 数字相位分析器和合成器
[摘要] 一种数字相位合成器包括一个连续相位数据信号源。一个内插器响应每个连续相位数据信号产生连续边沿配置数据信号。一个相位调制器产生具有放置在由连续边沿放置数据信号确定的时间的边沿的输出时钟信号。类似地，一个数字相位分析器包括一个具有边沿的串行二进制输入信号源。一个相位解调器产生表示串行二进制输入信号的每个边沿位置的连续数据信号。一个抽取器在低于串行二进制输入信号边沿的比率产生相位数据信号。
  [HT8495-0148-0010] 锁相环电路
[摘要] 一种锁相环电路包括一个压控振荡器(VCO)，一个相位比较器，用于检测基准信号和由VCO提供的反馈信号之间的相位差，一个输入电压控制单元，根据由相位比较器检测的辔徊羁刂铺峁└鳹CO的输入电压，一个转换单元，用于转换提供给VCO的输入电压的值，以及一个转换定时控制单元，根据给定的基准信号控制转换单元的转换定时，其中VCO根据从输入电压控制单元提供的输入电压控制反馈信号的频率。因此，VCO可快速地使反馈信号与基准信号同相位，并因此可有效地减少所需的闭锁时间。
  [HT8495-0115-0011] 延迟锁相回路装置与时钟信号产生方法
  [HT8495-0097-0012] 带开关－电容电阻的PLL环路滤波器
  [HT8495-0147-0013] 一种时钟锁相方法及锁相环
  [HT8495-0004-0014] 一种通信系统,通信装置和频率综合器
  [HT8495-0063-0015] 光学头位置倍速调整的方法
  [HT8495-0154-0016] 一种利用时钟产生倍频脉冲的方法

  [HT8495-0100-0017] PLL电路的模式转换方法和PLL电路的模式控制电路
  [HT8495-0140-0018] 低功率消耗的高频时脉产生器
  [HT8495-0024-0019] 一种时钟同步系统数字锁相环实现方法
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  [HT8495-0124-0021] 可调扩频时钟发生器及其实现方法
  [HT8495-0132-0022] 相位同步循环电路以及数据再生装置
  [HT8495-0051-0023] 注入型同步窄带再生锁相环
  [HT8495-0136-0024] 具有正弦波发生器的小数分频合成器
  [HT8495-0161-0025] 一种应用于数据锁相回路的相位补偿电路
  [HT8495-0193-0026] 占空度校正电路和具有该电路的延迟锁相环
  [HT8495-0149-0027] 锁相环频率合成器中的自调节装置及其自调节方法
  [HT8495-0061-0028] 简化的最大似然频差的鉴频信号处理方法及其鉴频器
  [HT8495-0095-0029] 用以产生与基准时钟脉冲信号频率同步的时钟脉冲信号的电路装置
  [HT8495-0099-0030] 锁相检测电路
  [HT8495-0091-0031] 时钟同步装置
  [HT8495-0116-0032] 以扰频方式修正相位锁定估计频率的锁相装置及方法
  [HT8495-0213-0033] 可降低突变干扰影响的相位频率检测装置及方法
  [HT8495-0026-0034] 双环路锁相环
  [HT8495-0054-0035] 一种高精度原子频标智能补偿方法及其装置
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  [HT8495-0019-0037] 用于同步参考时钟的锁相环
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图[HT8495-0022-0092] 锁相环路频率合成器
技[HT8495-0212-0093] 具有改进的锁相/解锁检测功能的锁相回路
术[HT8495-0001-0094] 锁相环电路及其控制方法
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电[HT8495-0023-0119] 锁相环控制电路和所用的控制方法
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